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tigerajs
Joined: 08 Feb 2006
Beiträge: 30
|  20 Feb 2006 3:17, was ist der Unterschied zwischen # 1 a <= b und a <= # 1 b | | |
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| | plz help me |
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Aravind
Beitritt: 29. Jun 2004
Beiträge: 589
Geholfen: 23
Ort: Indien
| | 20 Feb 2006 3:40, was ist der Unterschied zwischen # 1 a <= b und a <= # 1 b | | |
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| Es ist Faustregel u sollten nicht a = # 5 b;
u können # 5 a = b;
weil er blockiert Erklärung.
1.it Blöcke B-Wert für 5 Sekunden und geben Sie es zu einem
2.a = B-Wert vorkommen, nach 5 Sekunden.
simillary für nicht-blockierende Erklärung seiner umgekehrt
u muss ein <= # 5b
wont blockieren, weil sie die entsprechenden Erklärungen |
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jarodz
Beitritt: 12. März 2005
Beiträge: 100
Geholfen: 14
| | 20 Feb 2006 6:43, was ist der Unterschied zwischen # 1 a <= b und a <= # 1 b | | |
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| A. # 5 a = b, nach 5 Zeit-Einheit, die Simulator-Ausführung den Wert von B nach A
B. a = # 5 b, Simulator ausführen, wenn diese Aussage,
Halten Sie den aktuellen Wert von b, und dann dieser Wert zu einem keeped nach 5 mal Einheit.
Es ist identisch mit "<=".
Mit freundlichen Grüßen,
Jarod |
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nand_gates
Beitritt: 19. Jul 2004
Beiträge: 908
Geholfen: 120
| | 20 Feb 2006 8:32 Re: Was ist der Unterschied zwischen # 1 a <= b und a <= # 1 b | | |
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| Dies sind die Art und Weise ein Modell Transport verzögern und Trägheitseinschluss Verzögerung in Verilog-Simulator.
Wenn ur sind vertraut mit VHDL, erhalten Sie es!
Ich gehe davon aus zeitlichen als 1ns
# 1 a <= b / / Diese Modelle Verkehr Verzögerung b erscheint bei "A" nach 1 ns
a <= # 1 b / / Diese Modelle Trägheitseinschluss Verzögerung "A" folgt "B" nach 1 ns Verzögerung bei additin zu diesem
alle Puls <1ns erhalten Filter auf "A"
Bitte lesen Sie den unten stehenden Link für VHDL!
http://www.gmvhdl.com/delay.htm |
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novise
Beitritt: 14. Feb 2006
Beiträge: 12
| | 20 Feb 2006 16:38 Re: Was ist der Unterschied zwischen # 1 a <= b und a <= # 1 b | | |
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| | wenn # 1A <= b wird b (t) wird eine zum Zeitpunkt t 1, auf der anderen Seite, wenn a <= # 1b wird B (t 1) wird auf eine zum Zeitpunkt t 1 |
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rsjgs
Beitritt: 14. Feb 2006
Beiträge: 10
| | 26 Feb 2006 19:37 Re: Was ist der Unterschied zwischen # 1 a <= b und a <= # 1 b | | |
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| | Der Unterschied ist, dass im ersten Fall die Bewertung der RHS erfolgt sofort, aber die Zuordnung nach 1 ns. Im zweiten Fall Bewertung selbst erfolgt nach 1 ns |
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darylz
Beitritt: 24. März 2005
Beiträge: 132
Geholfen: 4
| | 27 Feb 2006 3:21, was ist der Unterschied zwischen # 1 a <= b und a <= # 1 b | | |
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| | gesagt ist, dass nand_gates Auszug! |
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bracketx
Beitritt: 11. Jan 2006
Beiträge: 12
| | 28 Feb 2006 13:20 Was ist der Unterschied zwischen # 1 a <= b und a <= # 1 b | | |
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| | hehe, gibt es mehrere Erklärungen. |
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positive_edge
Beitritt: 13. Feb 2006
Beiträge: 6
| | 01. März 2006 20:12 Re: Was ist der Unterschied zwischen # 1 a <= b und a <= # 1 b | | |
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| 1)
# 1 a <= b
Bewertung der Zuordnung ist die zeitliche Verzögerung von Kontrolle.
RHS Ausdruck bewertet.
Die Zuordnung ist also a <--- b (t 1)
2) a <= # 1 b
RHS Ausdruck bewertet.
Die Zuordnung wird durch die zeitliche Verzögerung und ist am Ende der Warteschlange.
Flow weiter.
a <- b auf Simulation Zeitpunkt t 1 |
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AlexWan
Beitritt: 26. Dezember 2003
Beiträge: 305
Geholfen: 6
| | 02. März 2006 9:44 Re: Was ist der Unterschied zwischen # 1 a <= b und a <= # 1 b | | |
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| 1 # N a <= b
Hinzufügen von Verzögerungen bei der linken Seite (LHS) der nonblocking Aufgaben nach Muster kombinatorische Logik ist mangelhaft.
| Code: |
Modul adder_t2 (CO, Summe, A, B, CI);
CO-Ausgang;
Leistung [3:0] sum;
input [3:0] a, b;
Input-ci;
reg CO;
reg [3:0] sum;
immer @ (a oder b oder CI)
# 12 (CO, Summe) <= a b ci;
endmodule
|
Wenn die A INPUT Änderungen zum Zeitpunkt 15, dann, wenn die A, B und CI-Eingänge alle Veränderungen in den nächsten 9NS, die Ergebnisse werden auf dem neuesten Stand der Werte von A, B und CI. Dies erlaubt die Modellierung Stil ci Beitrag zu propagieren einen Wert auf die Summe und die Ergebnisse nach nur 3ns statt der geforderten 12ns Vermehrung Verzögerung.
So stellen Sie keine Verzögerungen bei der LHS der nonblocking Aufgaben nach Muster kombinatorische Logik. Dies ist ein schlechter Programmierstil.
Jeder kann sich die Jungs mehr Detail-INFORMATIONEN von Clifford E. Cummings Papiere. [/ Code] |
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Weng
Beitritt: 13. Jan 2006
Beiträge: 32
| | 03. März 2006 20:01 Re: Was ist der Unterschied zwischen # 1 a <= b und a <= # 1 b | | |
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| Sind diese blockiert und nonblocking Zuordnung der tatsächlichen Schaltung?
Kann mir jemand ein Beispiel-Code? |
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Vonn
Joined: 06 Oct 2002
Beiträge: 254
Geholfen: 2
| | 06. März 2006 2:25 Re: Was ist der Unterschied zwischen # 1 a <= b und a <= # 1 b | | |
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| sicher, dass es funktioniert ... Hier ist ein Beispiel:
Wenn Sie schreiben in Ihrem Prozess:
a = 1;
b = a;
c = b;
Es handelt sich um Sperren Zuordnung a = b = c = 1 und die erzeugte Schaltung wird ein 3-Puffer mit jeweils anderen
1 --- [Puffer ]---> A --- [Puffer ]---> b --- [Puffer ]---> c
während Sie schreiben, wenn sie mit nicht-blockierende
a <= 1;
b <= a;
c <= b;
Dies ist Nonblocking Zuordnung heißt das:
a = 1
b = alter Wert eines
c = alten Wert von b
und der tatsächlichen Schaltung wird f / f anstelle von Puffer
1 --- [F / F ]---> A --- [F / F ]---> b --- [F / F ]---> c |
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yuenkit
Beitritt: 20. Jan 2005
Beiträge: 110
Geholfen: 5
| | 10. März 2006 10:21 Re: Was ist der Unterschied zwischen # 1 a <= b und a <= # 1 b | | |
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| | Transport-Verzögerung und Trägheitseinschluss Verzögerung |
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Weng
Beitritt: 13. Jan 2006
Beiträge: 32
| | 14. März 2006 3:41 Re: Was ist der Unterschied zwischen # 1 a <= b und a <= # 1 b | | |
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| | Zitat: | Sind diese blockiert und nonblocking Zuordnung der tatsächlichen Schaltung?
Kann mir jemand ein Beispiel-Code?
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Es tut mir leid, dass ich nicht meine Frage klar.
Was ich fragen wollte ist, ob diese Sperrung und nonblocking Zuordnungen mit Verzögerungen der tatsächlichen Schaltung. Wie wirken sich die Verzögerungen in den beiden Aufgaben zu synthetisieren Schaltung? |
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shiv_emf
Beitritt: 31. Aug 2005
Beiträge: 641
Geholfen: 16
| | 09 Sep 2006 18:18 Was ist der Unterschied zwischen # 1 a <= b und a <= # 1 b | | |
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| | Vonn hat schönes Beispiel! Kann ich sie für die Gestaltung Schieberegister? / |
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archillios
Beitritt: 29. Jun 2005
Beiträge: 97
Geholfen: 4
| | 12 Sep 2006 16:53 Re: Was ist der Unterschied zwischen # 1 a <= b und a <= # 1 b | | |
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| AlexWan ist richtig, das ist ein schlechter Stil, wenn Codierung in kombinatorische Logik Modellierung. Vielen Dank für Alex!
sehen Sie den Code unten ein:
/ *
Bad Coding Style Beispiel
* /
Modul adder_t2 (CO, Summe, A, B, CI);
CO-Ausgang;
Leistung [3:0] sum;
input [3:0] a, b;
Input-ci;
reg CO;
reg [3:0] sum;
immer @ (a oder b oder CI)
# 12 (CO, Summe) <= a b ci; / / Bad-Block-Zuordnung nicht unverzüglich Coding Style
endmodule
Modul TB;
reg [3:0] a, b;
reg ci;
wire [3:0] sum;
Draht-co;
adder_t2 dut (. CO (CO),. Summe (Summe),. a (a). b (b),. ci (ci));
ersten
beginnen
# 0 (A, B, CI) = (4'h1, 4'h1, 1'h0);
# 50;
# 11 (A, B, CI) = (4'h2, 4'h5, 1'h1);
# 5 (A, B, CI) = (4'he, 4'h0, 1'h1);
# 9 (A, B, CI) = (4'h5, 4'h1, 1'h0);
# 50;
$ display ( "Gute Nacht");
$ stop;
Ende
endmodule
/////////////////////////////////////////
unerwartetes Verhalten gesehen werden.
nach der A / B / CI wird verändert, die (CO, Summe) <= a b ci; ist auf 12 Einheiten Zeit später, bevor die Zeit kommen wird, jede Änderung der A / B / CI wird die Wirkung ( co, Summe), so dass die Verzögerung nicht # 12. |
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foster_cn
Beitritt: 14. Jan 2003
Beiträge: 74
Geholfen: 2
| | 14 Sep 2006 7:06, was ist der Unterschied zwischen # 1 a <= b und a <= # 1 b | | |
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| | hat die Nr. 1 in a <= # 1 b ist der Übergang flipflop Zeit? |
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darylz
Beitritt: 24. März 2005
Beiträge: 132
Geholfen: 4
| | 14 Sep 2006 7:13, was ist der Unterschied zwischen # 1 a <= b und a <= # 1 b | | |
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| | Zuordnung der Sequenz ist anders! |
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